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HDL
基于Matlab Hdl Coder实现FPGA程序开发（卡尔曼滤波算法实现）
FPGA极其不擅长复杂算法的运算，但是如果项目中涉及一些高级算法的实现，在没有可封装IP核调用的形式下，应 […]
Verilog HDL 4*4矩阵键盘扫描程序 – 路漫漫…
硬件电路图如下： 1module key 2 3( 4 5 clk, //50MHZ […]
【连载】 FPGA Verilog HDL 系列实例——–直流电机PWM控制
【连载】 FPGA Verilog HDL 系列实例 Verilog HDL 之 直流电机PWM控制 一、 […]
基于Verilog HDL 的数字时钟设计
基于Verilog HDL的数字时钟设计 一、实验内容： 利用FPGA实现数字时钟设计,附带秒表功能及 […]
【连载】 FPGA Verilog HDL 系列实例——–矩阵键盘接口
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Verilog HDL 之 LCD1602英文显示
从即日起，开始将自己变成一名真正的程序猿…… 今天开始使用Verilog HDL进行建模，首先真是的 […]
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AXI总线slave模式下接收数据—verilog代码
AXI总线slave模式下接收数据—verilog代码 Posted on 2020-05-15 […]
verilog HDL 进击之路
Verilog 进击之路 – 夯实基础第一节之结构化设计 随着数字电路设计的复杂化和 […]
FPGA Asynchronous FIFO设计思路（2）
FPGA Asynchronous FIFO设计思路（2） Posted on 2018-10-26 09:4 […]
FPGA调试技巧
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